中心議題:
- 上升沿和下降沿取決于基頂值和基底值的確定
- 寬度、周期和延遲等時間參數(shù)在中間線處測量
- 合理設(shè)置水平軸測量中的Hysteresis(磁滯)能有效防止噪聲或其它干擾
問題:
“在測試信號邊沿的上升/下降時間的時候,跟我選擇的存儲深度有沒有關(guān)系。比如我使用40GS/S的采樣率測試PCIE CLK,如果在屏幕上顯示一個時鐘周期測試它的上升下降時間和我調(diào)節(jié)時基到8M的存儲深度時測試到的上升下降時間有沒有區(qū)別?”
回答:
你知道示波器中上升時間是怎么確定的嗎?如果說是“上升沿”的10%-90%,那“上升沿”指的是什么呢?如果你會從波形的下面指到上面,那是指下面的最小值點到上面的最大值點還是下面的平均值位置到上面的平均值位置呢?這些都涉及示波器對上升時間的算法定義。
示波器里計算上升沿需要定義“算法”。IEEE定義的算法如圖一所示。上升沿的確定取決于參數(shù)“top”(基頂)和“base”(基底)的確定。 正確的確定基頂和基底是正確的參數(shù)計算的基礎(chǔ)。在分析的開始,示波器首先計算一個波形數(shù)據(jù)的直方圖,時間跨度由兩個時間光標(biāo)之間的時間值確定,默認(rèn)情況下光標(biāo)是從最左邊到最右邊。例如,如果波形是在兩個狀態(tài)躍變的,那么其直方圖將包括兩個波峰。分析方法將嘗試識別包含了最大的數(shù)據(jù)密度的這兩組數(shù)據(jù)。于是,和這兩組相關(guān)聯(lián)的最大概率的狀態(tài)將被計算出來,以決定基頂和基底。基頂相對應(yīng)于上部的最大概率位置,基底相對應(yīng)于下部的最大概率位置。
圖一 示波器中一些常用測量參數(shù)的算法定義
頂部和底部樣本數(shù)的多少會影響到基頂和基底確定的準(zhǔn)確性。如果示波器上只一個時鐘周期,頂部和底部的樣本數(shù)很少,如果時鐘信號上有一點點的過沖或下沖就會影響到直方圖的分布的最大概率狀態(tài)的確定。因此,在測量時鐘我們建議屏幕上采集的周期數(shù)盡量多一些。至此,上面的問題的答案已是不言而喻的了。
值得說明的是,有時候示波器的參數(shù)下方的狀態(tài)顯示中有 的圖標(biāo),脈沖上的一個十字表示示波器不能夠確定基頂和基底,但是,測量仍然是有效的。[page]
圖二 一些時間參數(shù)的定義
在示波器水平軸測量中有一個常被忽略的選項叫Hysteresis(磁滯)。 Hysteresis選項利用了電平之上或之下的限制,這能防止測量到噪聲或其它干擾。Hysteresis的設(shè)置以milli-divisions(千分之一格)為單位指定,其設(shè)置的原則是:
1. Hysteresis 必須大于您希望忽略掉的最大噪聲尖峰。
2.可用的最大Hysteresis 值小于從電平到最近的波形極值的距離。
3.除非您知道將在任何周期內(nèi)發(fā)生的最大的噪聲和最近的極值電平,否則就在電平的兩側(cè)留出余量。
圖三所示為測試頻率為61.44MHz時鐘的TIE@lv參數(shù),但PLL在計算頻率時得到的結(jié)果為5.334099599GHz,這是因為缺省時Hystersis系數(shù)為500mdiv(即0.5格),示波器中將時鐘上升沿和下降沿的回鉤都當(dāng)作了是一個個小的脈沖來計算頻率,TIE@lv的測試結(jié)果也當(dāng)然錯了。
圖三 使用TIE的缺省設(shè)置,Hysteresis值為500mdiv
圖四 修改TIE的Hystersis設(shè)置